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AN-763
V EE
R4
C4
Application Note
1
R2
C2
AMPLIFIER A
1
1
–V1 1
–INA
G1 1
G1
+V1 1
+INA
G2 1
Rt1
Rt2
R7
R6
R5
C3
2
3
R3
1
4
8
R1
DUTA
1
DUT
C1
R8
R S 1
C S 1
R L 1
C L 1
VO1
V OUT A
G5
G3
G2
V CC
C5
Figure 13. Dual Universal Precision Op Amp Evaluation Board Electrical Schematic
C7
R10
AMPLIFIER B
1
–V2 1
–INB
G3 1
Rt3
R12
6
5
DUTB
7
DUT
R14
R S 2
R L 2
C L 2
VO2
V OUT B
G3
+V2 1
+INB
G4 1
R13
Rt4
R11
C6
R9
C S 2
1
G6
G6
G4
C8
Figure 14. Dual Universal Precision Op Amp Evaluation Board
Figure 15. Dual SOIC Layout Patterns
Rev. C | Page 6 of 8
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